电容布局

   接下来，设计工程师必须确定把电容放在PCB的哪个地方。它必须放在能够最小化电容和芯片间走线电感的地方。电感同样需要最小化，而不是走线长度。当把电容放到PCB上的时候，使电感而不是使走线长度最小化将允许更多的设计自由度。首先，设计工程师需要确定最大可用的走线长度来保持最大的设计自由度。

    过程如下：设计工程师需要一个工作在fmax(式3)到某个最高频率的电容。确定这个上界频率需要理解理想的数字波形输出和保持这个形状到某种程度的必要性。这是信号完整性设计的一个小部分。

    理想的数字电路传输一个矩形脉冲到下一个电路。实际上是无法实现矩形脉冲的，但是能实现梯形脉冲。检查梯形脉冲的傅利叶序列，发现梯形脉冲由基频和所有谐波组成。当然，把所有的都加在一起，就可以实现原始的梯形脉冲。

    但如果没有把所有的谐波加在一起会怎么样呢？如果只有最初的5个或者10个谐波相加会怎么样呢？是否有足够的谐波建立梯形脉冲而使输入电路不容易察觉变化呢？事实证明，在大多数情况下，只把前面10个谐波相加就可以让恢复出来的波形骗过大多数的电路，也就是说大多数的电路不会察觉变化。这就决定了设计去耦电容的时候需要处理的最高频率。另一个建议的方法，是利用f=1/tr确定最高频率，其中tr是脉冲上升时间。在这个频率，谐波能量很小，并以40dB/decade的速度滚降。

    现在可以确定最坏情况下电源电压可容忍的变化，从而开始设计。对CMOS来说，这个数字就是噪声预量VOH-VIH(从数据表上查这些值)。最坏情况下的变化为：

V = VCC(nominal)-(VOH+10%×VCC) (6)

10%即为电源的下降因子。

利用式6与电感的电流和电压，确定最大可允许的电感L:

L=V/(dI/dt) (7)

其中，L是电容、走线、芯片的连接线和引线等所引入总的串联电感，dI是最大电流变化，dt是电流的上升时间。

走线长度

    对于两个或更多个电容来说，它们平行连接到芯片电源输入管脚上的走线长度是不同的，有效地走线长度决定了电容可以放到离芯片多远的地方。走线长度直接和走线的电感相关。因此，通过平行电感的公式可得到有效的走线长度，有效走线长度IE为：

IE＝(I1×I2)/(I1+I2) (8)

其中I1和I2是平行电容的走线长度。每个平行电容离开VCC 管脚的最大距离是IE。

一旦电容选定并放在PCB上，就要检查什么地方会出现电容和寄生电感的。共振频率可以通过下式得到：

f=1/2π=π√-LC (9)

其中L=IE SL + LTRACE。

   超过这个频率，电容将迅速变为一个电感。如果共振频率发生在远低于10 * fpulse的频率上，则要检查设计，以采取折衷措施。

用多个去耦电容

    如果使用N个同等电容值的电容，总的ESL和ESR将减少到1/N(图2)。当连接电源和地之间电容的走线相等时，这是一个特殊的情况。同样也假定电感之间的互耦合很小。N个具有同样电容值的电容的阻抗曲线接近单个电容的曲线。

    如果采用N个不同电容值的电容，ESR和ESL会降低，但将在阻抗曲线引入一个共振峰值，并带来严重的设计后果(图3)。这里也再次假定走线长度相同。

使用PCB

    不要忘记PCB。忽视它几乎免费提供的诸多好处，将提高设计成本，增加额外的元件。这些额外的元件将占用额外的空间，降低总的可靠性并可能增加EMI。

式10给出了一组平行的电源层的阻抗公式。这只是串联LRC电路的阻抗公式。只要PCB没有开始像传输线一样工作，这个公式就是有用的。换句话说，如果l<λ/20，那么它是有用的。其中l是PCB的最大尺寸(对角线)，λ是和最高频率有关的波长。

直到这一点，PCB阻抗几乎是容性，并且能提供耦合电容截止频率之上的所有需要的电流。因为ESR非常小，寄生电感也非常小，因此PCB会在一个比较宽的频率范围呈现出很低的阻抗。

如果PCB具有两个相邻的电源和地层，那么它在设计中具有很好的内部电容。用于并联平面电容的计算公式可被用来确定PCB的电容：

C(pF)=ε(A/d)=0.225(εr /d)A (11)

上式的最后一部分在以英寸为单位的时候有效。其中，ε = ε0×εr，ε0是空气的介电常数，为8.85 pF/m，er是电容板之间介质的相对介电常数。对于FR4材料，er 等于4.5。A是电容板之间的面积，d是板之间距离。

    实际上，对于PCB向VCC管脚输入电流的能力，没有一个上限的频率限制。PCB的设计是一个复杂的题目，有许多可用的介质来增加上限频率。对于FR4材料，上限频率范围非常高，超过了2 GHz，这使得现在大多数汽车用PCB电路看起来上限频率是无限的。实际上，上限频率由PCB的最大尺寸l和最小波长λ决定。

    不幸的是，在自动设计中PCB的总电容值是很小的。当采用FR4作为电介质，板间隔为20mil，具有固定电源和接地层电容时，PCB电容通常约为53 pF/平方英寸。4层板的FR4 PCB会有一定范围的电介质厚度。这种变化可以是来自制程变化、整个板所需的厚度、所需的弹性或者硬度、铜厚(这会影响电介质厚度)以及击穿电压的要求。没有特殊要求下的PCB介质厚度变化幅度为0.5到0.8mm。

    PCB电容的质量通常很好优秀，因为很少有电感。就像前面所说，电感是电容器随着频率退化的主要原因。

    电容的小尺寸是一个值得注意因素。PCB上能够有效供应电流的电容值一般要超过500 pF/平方英寸。在FR4板上获得这个值是不可能的，因此需要特殊的PCB设计和材料。

EMC方面的好处

    除了从良好设计的电源分配系统得到的信号完整性外，PCB也会带来更低的EMI。正如前面所提到的，这主要是由于减小了环路面积。这以两种方式表现。首先，法拉第定律指出，通过流过其他电路的电流，环路面积A将给电路中带来电压。

VINDUCED(V)=[(?AN/2πd)×(dI/dt)×cos(θ) (12)

    同样，在数字电路中，电流回路引起电磁场的简化表达式表明较小的回路具有更低辐射：

E(V/m)=263×10-16×[f2A(I/r)] (13)

成本效益

    一个设计良好的电源分配系统可以节约很多成本。式14给出了器件减少和成本降低之间的简单关系。

    至此，讨论围绕着向芯片提供电流。但是设计者可能希望限制流向芯片的电流。请记住，一个芯片只要有低于上限频率(10 * fmax)，或者1/πtr的电流就能工作得很好。设计者不能接触那些频率上的任何电流。但是超过某个上限频率，芯片可以在无电流下工作得很好。此外，因为那些电流有可能产生EMI，所以它们可以被抑制，从而减小EMI。

    另外，为了限制电流，在去耦电容和芯片的VCC引线之间插入一个磁珠。在做这个之前，设计者必须知道他们不会使芯片缺少电流。

作者：Charles P. Capps